数字电子技术基础第四版课后答案7

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2024-04-29 发布于云南
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第七章半导体存储器[题7.1]存储器和寄存器在电路结构和工作原理上有何不同？[解]参见第7.1节。[题7.2]动态存储器和静态存储器在电路结构和读/写操作上有何不同？[解]参见第7.3.1节和第7.3.2节。[题7.3]某台计算机的内存储器设置有32位的地址线，16位并行数据输入/输出端，试计算它的最大存储量是多少？[解]最大存储量为232×16=210×210×210×26=1K×1K×1K×26=64G[题7.4]试用4片2114（1024×4位的RAM）和3线-8线译码器74LS138（见图3.3.8）组成4096×4位的RAM。[解]见图A7.4。[题7.5]试用16片2114（1024×4位的RAM）和3线-8线译码器74LS138（见图3.3.8）接成一个8K×8位的RAM。[解]见图A7.5。[题7.6]已知ROM的数据表如表P7.6所示，若将地址输入A3A2A1A0作为4个输入逻辑变量，将数据输出D3D2D1D0作为函数输出，试写出输出与输入间的逻辑函数式。表P7.6[解]D3=0123012301230132AAAAAAAAAAAAAAAAD2=01230123012301230132AAAAAAAAAAAAAAAAAAAA+0132AAAAD1=0123012301230132AAAAAAAAAAAAAAAAD0=01230132AAAAAAAA[题7.7]图P7.7是一个16×4位的ROM，A3、、A2、A1、A0为地址输入，D3、D2、D1、D0是数据输出，若将D3、D2、D1、D0视为A3、、A2、A1、A0的逻辑函数，试写出D3、D2、D1、D0的逻辑函数式。[解]01230123012301233AAAAAAAAAAAAAAAAD0123012301232AAAAAAAAAAAAD012301230123012301231AAAAAAAAAAAAAAAAAAAAD012301230123012301230AAAAAAAAAAAAAAAAAAAAD01230132AAAAAAAA[题7.8]用16×4位的ROM设计一个将两个2位二进制数相乘的乘法器电路，列出ROM的数据表，画出存储矩阵的点阵图。[解]设两个2位二进制数为A1A0和B1B0乘积为D3D2D1D0。依题意可列出ROM的数据地址输入数据输出地址输入数据输出A3A2A1A0D3D2D1D0A3A2A1A0D3D2D1D000000001001000110100010101100111000100100010010000100100010010001000100110101011110011011110111100100100010010000100100010000001表，如表A7.8所示。表A7.8由表A7.8可画出存储矩阵的点阵图，如图A7.8所示。[题7.9]用ROM设计一个组合逻辑电路，用来产生下列一组逻辑函数BDBDYBCDABDYABCDABCDABCDABCDYABCDABCDABCDABCDY4321列出ROM应有的数据表，画出存储矩阵的点阵图。[解]将函数化为最小项之和形成后得到1513108752041075231387221510501mmmmmmmmYmmmmYmmmmYmmmmY地址数据地址数据A3...

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